时序MIPI调试总结

调试  时间:2021-02-19  阅读:()

mipi调试经验

以下是最近几个月在调试MIPIDSI /CSI的一些经验总结因为协议有专门的文档所以这里就记录一些常用知识点

一、 D-PHY

1、传输模式

LP Low-Power 模式用于传输控制信号最高速率10 MHz

HSHigh-Speed模式用于高速传输数据速率范围[80 Mbps 1Gbps]perLane

传输的最小单元为1个字节采用小端的方式及LSB first MSB last。

2、 Lane States

* LP mode有4种状态 LP00、 LP01 0 、 LP10 1  、 LP1 1 Dp、Dn

*HS mode有2种状态 HS-0、 HS-1

HS发送器发送的数据LP接收器看到的都是LP00

3、 Lane Levels

*LP 0~1 .2V

*HS 100~300mV HS common level=200mV swing=200 mv

4、操作模式

在数据线上有3种可能的操作模式 Escape mode,High-Speed(Burst)modeand Control mode下面是从停止状态进入相应模式需要的时序

*Escape mode进入时序 LP1 1→LP10→LP00→LP01→LP00退出时序LP10→LP1 1

当进入Escape mode需要发送8-bitentry command表明请求的动作 比如要进行低速数据传输则需要发送cmd 0x87进入超低功耗模式则发送cmd0x78。在DSI中LP通讯只用Data Lane 0。

*High-Speed mode进入时序 LP1 1→LP01→LP00→SoT(0001_1 101)退出时序 EoT→LP1 1 时序图如下

1

*Turnaround进入时序 LP1 1→LP10→LP00→LP10→LP00退出时序LP00→LP10→LP1 1

这是开启BTA的时序一般用于从slave返回数据如ACK 0x84。

5、时序要求

在调试DSI或者CSI的时候 HS mode下的几个时序非常重要 T_LPXT_HS-SETTLE≈T_HS-PREPARE+T_HS-ZERO T_HS-TRAIL一般遵循的原则为 Host端的T_HS-SETTLE>Slave端的T_HS-SETTLE。

二、 DSI

1、线路构成

在DSI中需要1根时钟线以及1~4根数据线。

2、两种接口的LCD

*Command mode 对应MPU接口

*Video mode 对应RGB接口

该模式下视频数据只能通过HS mode传输。

3、数据包类型

短包 4 bytes 由3部分组成

*Data Identifier(DI) * 1 byte Contains the Virtual Channel[7:6]and DataT yp e[5:0].

*Packet Data*2byte Length is fixed at two bytes

*Error Correction Code(ECC)* 1 byte al lows single-bit errors to be correctedand 2-bit errors to be detected.

长包 6~65541 bytes 同样由3部分组成

*Packet Header(4 bytes) -包头

Data Identifier(DI)* 1byte Contains the Virtual Channel[7:6]and DataT yp e[5:0].

Word Count (WC) *2byte defines the numberof bytes in the Data Payload.

2

Error Correction Code(ECC)* 1 byte al lows single-bit errors to be correctedand 2-bit errors to be detected.

*Data Payload(0~65535 bytes) -有效数据

Length=WC×bytes

*Packet Footer(2 bytes) Checksum-包尾

If the payload has length 0, then the Checksum calculation results in FFFFhIf the Checksum isn’tcalculated, the Checksum value is 0000h

4、从控制器到外设发送的包类型

如果希望从外设读取数据或者状态则在处理器发送完读取命令后还需要发送BTA命令非读取命令在外设接收成功后会返回trigger message 0x84。

5、从外设到处理器数据包类型

3

返回的数据一般分为4个类型

*Tearing Effect (TE) trigger message(BAh)

*Acknowledge trigger message(84h)

*Acknowledge and Error Report short packet (Data Type is 02h)

*Response to Read Request short packet or long packet

Generic Read Response、 DCS Read Response 1 byte,2byte,multi byte读取数据返回值解析示例如下

[cpp] view plain copy

6、 Video模式的3种数据格式

*Non-Burst Modewith Sync Pulses

*Non-Burst Mode with Sync Events

*Burst Mode

*调试记录

LCD半边闪屏问题原厂给的信息分析了系統板送出的video modeti ming資訊摘要如下

HSCLK: 160MHz

Per lane bit-rate:320Mbps(UI=3.125ns)

HS SoT HS-prepare+HS-zero約155ns

由上述的timing懷疑與現象是因為IC HS data settle timing搭配不當

5

所導致

看来是我们输出的mipi信号HS-prepare+HS-zero比LCD默认设置短引起的。还有随机整屏闪动的问题通过调节VFP和VB P的值调到了理想状态。另外LCD的VCC在使用mos管控制后休眠后会有2.0V的悬浮电压通过RC电路将电压放掉将C 78换成了10 K电阻。

LCD电路上有几个比较重要的电压:AVDD、VCC、VGH、VGL、HAVDD、VCOM由AVDD通过电阻分压得到

*唤醒慢的问题

在最初调试的几款LCD里面初始化cmd都比较少后来在调试一款IPS屏的时候发现唤醒需要3秒左右这款LCD初始化cmd有100多条之前在调试一款LCD的时候每条cmd发送之后需要delay 10ms再发下一条cmd所以在这款LCD这里不能有delay并且经过调试在确保发送成功的情况下将LP的传输速度提高了3倍这里需要读取每条cmd的返回值0x84确认命令是否发送成功 优化后唤醒时间不到1秒。

*LCD参数理解更正

才发现之前一直对LCD的几个参数HFP、 HBP、VFP、VBP理解有错误正确的应该是以同步信号HSYNC、 VSYNC为基准在同步信号之前的称为Front在同步信号之后的称为Back而不是之前理解的以有效像素为基准。

*LCD显示呈锯齿状问题

这两天12.1 1 还调试了一款540x960分辨率的mipiLCD在开始的时候一直点不亮和供应商确认了好久无意间才发现是他们给的初始化代码是错的使用正确的初始化代码就能点亮了不过显示出来的图像却是呈锯齿状的即没有对齐。之前在别的平台也遇到过类似问题也就是分辨率不是16的整数倍LCD control ler在取数据的时候会对不齐。边研究Datasheet边和ASIC同事讨论后来确定了一个方案 即在DSI、 LCD寄存器里面设置分辨率为540x960以让LCD正确识别信号但framebuffer需要设置为544 x960以对齐并且设置Source pitch寄存器为544这样显示就正常了相当于frameb uffer里每一行的最后4个pixe l会被LCD control ler丢掉。

今天12.12在和ASIC同事的讨论下更正了之前的理解 LCD control ler在计算取数据的时候地址是根据xy坐标来算的差不多是address=y*pitch+x+base pitch就是一行pixel在内存里的大小这个至少是要对齐到8byte 因为bus宽度是8byte如Data sheet中的描述”Source pitch forRGB channel ,QWORD al igned if l inear mode“。之前计算pitch值的公式为xres/8*b i ts_pe r_p i xe l /8如果xres=540 b i ts_pe r_p i xe l=32计算的结果因为取整的原因为0x10c实际上正确的值应该是0x10e所以需要将公式

6

改为 xre s* (b i ts_p e r_p i xe l /8) /8即在每个像素占4 b yte的情况下只要xre s为偶数就可以满足对齐的要求而不用改为544。

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